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[源代码]基于Quartus Prime的数字系统Verilog HDL设计实例详解(第3版)

更新时间：2022-11-09 20:48:45 大小：61K 上传用户：Laspide查看TA发布的资源 标签：quartusprime数字系统veriloghdl 下载积分：2分 评价赚积分 （如何评价?） 打赏 收藏 评论(0) 举报

资料介绍

以语法与实例结合的方式来讲解可编程逻辑器件的设计方法，软件开发平台为Altera公司的Quartus Prime 16.1 FPGA/CPLD设计软件。由浅入深地介绍了利用Quartus Prime进行数字系统开发的设计流程、设计思想和设计技巧。书中的例子非常丰富，既有简单的数字逻辑电路实例，也有复杂的数字系统设计实例。

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[源代码]基于Quartus Prime的数字系统Verilog HDL设计实例详解(第3版)/example_10/10.1.v2KB2013-06-30 09:00:42
[源代码]基于Quartus Prime的数字系统Verilog HDL设计实例详解(第3版)/example_10/10.2.v1KB2013-06-30 09:01:24
[源代码]基于Quartus Prime的数字系统Verilog HDL设计实例详解(第3版)/example_10/10.3.v2KB2013-06-30 09:01:50
[源代码]基于Quartus Prime的数字系统Verilog HDL设计实例详解(第3版)/example_10/10.4.v1KB2013-06-30 09:02:22
[源代码]基于Quartus Prime的数字系统Verilog HDL设计实例详解(第3版)/example_11/11.1.v3KB2013-06-30 09:04:04
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[源代码]基于Quartus Prime的数字系统Verilog HDL设计实例详解(第3版)/example_11/11.3.v3KB2013-06-30 10:22:52
[源代码]基于Quartus Prime的数字系统Verilog HDL设计实例详解(第3版)/example_11/11.4.v3KB2013-06-30 10:23:24
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