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FPGA片上硬件乘法器的使用
资料介绍
硬件乘法器，其基础就是加法器结构，它已经是现代计算机中必不可少的一部分。[1] 乘法器的模型就是基于“移位和相加”的算法。在该算法中，乘法器中每一个比特位都会产生一个局部乘积。
部分文件列表
| 文件名 | 文件大小 | 修改时间 |
| 实战训练20 FPGA片上硬件乘法器的使用/project/.untf | 1KB | 2008-06-01 14:10:08 |
| 实战训练20 FPGA片上硬件乘法器的使用/project/automake.log | 1KB | 2008-06-01 14:10:52 |
| 实战训练20 FPGA片上硬件乘法器的使用/project/bitgen.ut | 1KB | 2008-06-01 14:10:38 |
| 实战训练20 FPGA片上硬件乘法器的使用/project/core.tpl | 1KB | 2008-06-01 14:17:50 |
| 实战训练20 FPGA片上硬件乘法器的使用/project/coregen.log | 1KB | 2008-06-01 14:18:28 |
| 实战训练20 FPGA片上硬件乘法器的使用/project/genExpectedResults.cmd | 1KB | 2006-10-05 14:54:42 |
| 实战训练20 FPGA片上硬件乘法器的使用/project/iir.bgn | 5KB | 2008-06-01 14:10:52 |
| 实战训练20 FPGA片上硬件乘法器的使用/project/iir.bit | 207KB | 2008-06-01 14:10:52 |
| 实战训练20 FPGA片上硬件乘法器的使用/project/IIR.bld | 1KB | 2008-06-01 14:10:08 |
| 实战训练20 FPGA片上硬件乘法器的使用/project/IIR.cmd_log | 2KB | 2008-06-01 14:10:40 |
| 实战训练20 FPGA片上硬件乘法器的使用/project/iir.drc | 1KB | 2008-06-01 14:10:44 |
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