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EDA时钟顶层设计VHDL源码.zip
资料介绍
部分文件列表
| 文件名 | 大小 |
| EDA时钟顶层设计VHDL源码/ | |
| EDA时钟顶层设计VHDL源码/EDA时钟顶层设计VHDL源码/ | |
| EDA时钟顶层设计VHDL源码/EDA时钟顶层设计VHDL源码/Clock_cnt.v | 5KB |
| EDA时钟顶层设计VHDL源码/EDA时钟顶层设计VHDL源码/Clock_ctl.v | 1KB |
| EDA时钟顶层设计VHDL源码/EDA时钟顶层设计VHDL源码/Display.v | 1KB |
| EDA时钟顶层设计VHDL源码/EDA时钟顶层设计VHDL源码/Freq_div.v | 1KB |
| EDA时钟顶层设计VHDL源码/EDA时钟顶层设计VHDL源码/Key_ctl.v | 2KB |
| EDA时钟顶层设计VHDL源码/EDA时钟顶层设计VHDL源码/buzzer.v | 1KB |
| EDA时钟顶层设计VHDL源码/EDA时钟顶层设计VHDL源码/db/ | |
| EDA时钟顶层设计VHDL源码/EDA时钟顶层设计VHDL源码/db/dingceng.(0).cnf.cdb | 2KB |
| EDA时钟顶层设计VHDL源码/EDA时钟顶层设计VHDL源码/db/dingceng.(0).cnf.hdb | 1KB |
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