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基于EDA技术的兼容MCS—51单片机IP核设计
资料介绍
本文采用自顶向下(Top-down)的设计方法,根据设计流程,首先将单片机划分成几个大的模块,再向下划分成功能单一的模块.然后运用硬件描述语言VHDL(Very High Speed Integrated Circuit Hardware Description Language)对各个模块进行逻辑描述;同时应用EDA集成开发工具MAX+plusⅡ提供的时序模拟器对各个模块(包括各子模块和顶层模块)的功能进行软件仿真.完成软件仿真后下载到FPGA/CPLD器件中进行硬件级的测试.课题采用SE-5M型EDA实验箱对所设计的软核模块进行硬件级的测试.箱内的可编程逻辑器件是Altera公司的FLEX 10K(属于FPGA类型)系列器件中的EPF10K10LC84-4.由于EPF10K10LC84-4器件的逻辑门有限,本文单独完成了算术逻辑单元、定时器/计数器、串行口等模块的硬件级测试.
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| 基于EDA技术的兼容MCS—51单片机IP核设计.pdf | 3M |
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