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大小核混合架构的核心设计逻辑
资料介绍
一、大小核混合架构的诞生背景
在半导体工艺进入微纳米级瓶颈后，单纯依靠提升芯片主频、增加同构核心数量来提升性能的路径逐渐遇到天花板。一方面，高主频带来的功耗和发热呈指数级增长，移动设备和轻量化桌面设备无法承受过高的热设计功耗；另一方面，多数日常应用场景中，计算任务的负载具有明显的异构性——既有需要瞬间爆发性能的重度计算任务，也有大量长期后台运行的轻量级任务，如果全部采用高性能大核，会造成大量的性能浪费和不必要的功耗消耗。正是在这样的产业背景下，大小核混合架构应运而生，它通过差异化核心设计匹配不同类型的计算需求，实现性能与功耗的平衡，这也是大小核架构最根本的出发点。
早期移动芯片领域首先探索大小核设计，因为手机对续航的敏感度远高于桌面设备，初期的设计更多是简单的任务分流，并没有形成系统化的调度逻辑，而随着英特尔、AMD先后推出x86平台的大小核产品，大小核架构已经从移动端延伸到桌面端、服务器端，成为当前主流芯片的标准设计方案。
二、核心设计逻辑一：差异化核心定位，匹配异构计算需求
大小核架构最核心的设计逻辑，就是基于计算任务的特性差异化定义核心，让合适的核心处理合适的任务，这也是大小核区别于传统同构多核架构的根本特征。
（一）大核的设计定位：高性能计算承载
大核全称为性能核（Performance Core，简称P核），设计目标就是追求单线程峰值性能，因此在硬件设计上，大核会配备更宽的指令流水线、更大的缓存容量、更激进的动态频率调整策略，支持更复杂的乱序执行技术，能够在短时间内输出极高的单线程计算能力。大核主要承担的任务包括重度计算场景：比如大型游戏的主线程计算、视频编码渲染、大型工程软件计算、应用程序冷启动等需要瞬时高性能的任务，这类任务对延迟敏感，需要核心快速完成计算，因此交给高主频、高单线程性能的大核处理是最优选择。
从硬件参数来看，大核通常占用更大的芯片面积，比如Intel 12代酷睿的P核面积约为小核的2.5倍，单核心功耗也能达到小核的3~4倍，正是这样的硬件投入保证了大核的峰值性能。
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| 文件名 | 大小 |
| 大小核混合架构的核心设计逻辑.docx | 16K |
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