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8051/ CPLD/ FPGA/ DSP发展系统使用说明
资料介绍
主控元件可选用ALTERA ACEX-1K或XILINX系列等其他晶片，可模拟30,000个以上的逻辑闸，搭配MAX +PLUSⅡV10.1等发展软件。
2.使用硬体描述语言AHDL / VHDL及绘图法来设计逻辑电路，方便学习。
3.每一外接I / O PIN脚都有标标，透过外接I / O排针座可对外部实验电路做控制，弹性空间大。
4.频率产生器频率范围：1/10/100 / 1K / 10K / 100K / 1M / 10M / 20M Hz。
5. CPLD / FPGA部份，经打印机端口介面连线可进行烧录。
6. 8051部份，可经由Com1或Com2 Port进行烧录（ISP）。
7.支援Windows作业系统
部分文件列表
| 文件名 | 大小 |
| d5f89cecf0a41d3db5c8b133b62154ec.pdf | 2M |
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