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FPGA控制AD7266
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| 文件名 | 文件大小 | 修改时间 |
| ad7266.v | 3KB | 2015-10-09 21:43:04 |
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资料：bitboy
全部评论(1)
2022-05-13 13:56:23BEATAH
采用后试了下，暂时还有点问题。仿真后的时钟周期只有13个SCLK，可能还是要结合硬件图看是什么模式。。