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FPGA-Quartus-II-时钟约束
资料介绍
FPGA-Quartus-II-时钟约束
约束所有时钟(包括你的设计中特有的时钟)对准确的时序分析结果而言是必不可少的。Quartus II TimeQuest Timing Analyzer为各种各样的时钟配置和典型时钟提供许多SDC命令。
这个章节将介绍SDC可用的应用编程接口,以及描述指定的时钟特性
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FPGA-Quartus-II-时钟约束.doc | 191K |
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