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FPGA基于verilog-HDL的密码锁
大小:626K 更新时间:2018-09-15 下载积分:1分
以往机械锁使用繁琐,安全性低,灵活性差,应用领域有限。而密码锁可以 应用于各个领域,如电子产品的保密,系统程序的保密等各种数字信息产品的加密保密。还可通过外接物理系统,取代传统机械锁,应用于日常生活的...
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用Verilog-HDL实现I2C总线功能
大小:238K 更新时间:2018-09-15 下载积分:2分
简述了12C总线的特点;介绍了开发FPGA时12C总线模块的设计思路;给出并解释了用Verilog HDL实现部分12C总线功能的程序,以及12C总线主从模式下的仿真时序图。
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秒表的设计-Verilog-HDL
大小:60K 更新时间:2018-09-15 下载积分:1分
基本原理: 本设计中用到的主要元件有计数器、分频器、数据选择器、译码器、位选信号发生器等。秒、分都是60进制计数,所以必须采用两个60进制的计数器,而百分秒择采用的是100进制;分频器主要将1KHZ的时钟信号经...
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FPGA的四路抢答器的Verilog-HDL代码
大小:51K 更新时间:2018-09-15 下载积分:1分
module qiangda4(clk,clr,inputEn,add,stu,inputL1,inputL2,inputL3,inputL4,Led1,Led2,Led3,Buzzer); // 开始声明各个端口 //输入口 input clk,clr,inputEn,add,stu,inputL1,...
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