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4位异步二进制减法计数器,利用QUARTUS II 9的CPLD_FPGA
大小:27K 更新时间:2019-10-17 下载积分:8分
FPGA的仿真实例,Verilog代码编写,过程详尽,代码易懂
大小:16K 更新时间:2019-10-17 下载积分:8分
FPGA Verilog实现电话计费系统. FPGA Verilog实现电话计费系统.
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32K点的FFT FPGA实现以及相关的Matlab程序
移位寄存器,Verilog实现,有实验说明文档.
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lalahug
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