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XILINX ISE14.5设计教程
资料介绍
基于VHDL语言的ISE设计流程一设计内容
使用ISE14.5完成一个数字系统的设计，其内容包括：
·工程的建立；
·三位计数器的设计；
·设计综合和查看综合结果；
·三位计数器设计仿真；
●分频器的设计；
·用户约束的添加和设计实现；布局布线结果的查看；
·设计下载到FPGA芯片
·PROM文件的生成和下载到PROM中
基于VHDL语言的ISE设计流程一对该设计文件进行综合
行为级综合可以自动将系统直接从行为级描述综合为寄存器传输级描述。
行为级综合的输入为系统的行为级描述，输出为寄存器传输级描述的数据通路。
行为级综合工具可以让设计者从更加接近系统概念模型的角度来设计系统。同时，行为级综合工具能让设计者对于最终设计电路的面积、性能、功耗以及可测性进行很方便地优化。
行为级综合所需要完成的任务从广义上来说可以分为分配、调度以及绑定。
部分文件列表
| 文件名 | 大小 |
| XILINXISE14.5设计教程.pdf | 13M |
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