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数码管扫描设计VHDL源代码
资料介绍
代码:
library ieee;use icee.std logic 1164.all;use ieee.std logic arith.all;use ieee.std_logic_unsigned.all;entity haut is port(
clk,rst:in std logic;aux:out std_logic_vector(6 downto 0);cat:out std_logic_vector(5 downto 0)
);end haut;architecture bon of haut is signal premiere:std_logic_vector(2 downto 0);signal num:std_logic_vector(6 downto 0);begin process(clk,rst)
begin if(rst='1)then premiere<="111";num<="0000000";elsiftclk'event and clk='1)then
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数码管扫描设计VHDL源代码.pdf | 204K |
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资料:bitboy
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