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verilog实现的AES-128加解密程序，FPGA验证通过
资料介绍
verilog实现的AES-128加解密程序，FPGA验证通过
部分文件列表
| 文件名 | 文件大小 | 修改时间 |
| aes/aes.v | 11KB | 2010-03-20 20:02:36 |
| aes/aes_ram.v | 6KB | 2010-03-18 20:35:50 |
| aes/apb_interface.v | 2KB | 2010-03-18 17:21:38 |
| aes/keysched.v | 3KB | 2010-03-22 16:17:28 |
| aes/mixcolum.v | 2KB | 2010-03-22 15:30:30 |
| aes/sbox.v | 9KB | 2010-03-20 20:01:50 |
| aes/subbytes.v | 3KB | 2010-03-20 10:03:24 |
| aes/word_mix.v | 2KB | 2010-03-22 15:57:06 |
| aes | 1KB | 2011-04-19 10:03:38 |
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全部评论(3)
2022-03-01 22:27:33farmeruser
可一下，有用
2021-11-21 17:38:1721321312
好
2021-03-31 15:24:25zzwwzz
很好