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用Verilog设计了一个两个8位二进制数的乘法器
资料介绍
用Verilog设计了一个两个8位二进制数的乘法器
部分文件列表
| 文件名 | 大小 |
| mul8/ | |
| mul8/db/ | |
| mul8/db/.cmp.kpt | |
| mul8/db/logic_util_heursitic.dat | |
| mul8/db/mul8.(0).cnf.cdb | 5KB |
| mul8/db/mul8.(0).cnf.hdb | 1KB |
| mul8/db/mul8.asm.qmsg | 2KB |
| mul8/db/mul8.asm.rdb | 1KB |
| mul8/db/mul8.asm_labs.ddb | |
| mul8/db/mul8.cbx.xml | |
| mul8/db/mul8.cmp.bpm | 1KB |
| ... | |
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