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spi时序仿真verilog源码及testbench

更新时间：2021-11-04 23:08:23 大小：66K 上传用户：hailang@123查看TA发布的资源 标签：spi时序仿真verilog 下载积分：2分 评价赚积分 （如何评价?） 打赏 收藏 评论(0) 举报

资料介绍

verilog HDL源码及modelsim仿真模型；基础简单适合学习

部分文件列表

文件名文件大小修改时间
spi_interface/spi_interface.v2KB2021-09-05 11:45:26
spi_interface/spi_tb.cr.mti1KB2021-09-20 23:31:06
spi_interface/spi_tb.mpf97KB2021-09-20 23:31:04
spi_interface/spi_tb.v1KB2021-09-05 10:53:16
spi_interface/vsim.wlf96KB2021-09-20 23:31:06
spi_interface/work/@_opt/vopt0znhc91KB2021-09-05 11:45:40
spi_interface/work/@_opt/vopt1m0f5j1KB2021-09-05 11:30:36
spi_interface/work/@_opt/vopt3xbei91KB2021-09-05 11:45:40
spi_interface/work/@_opt/vopt45nb5j1KB2021-09-05 11:30:36
spi_interface/work/@_opt/vopt7d1bi93KB2021-09-05 11:45:40
spi_interface/work/@_opt/vopt8mb85j1KB2021-09-05 11:30:36
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