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PANGO LOGOS2 FPGA CAMERALINK实现代码
资料介绍
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| 文件名 | 大小 |
| pgr_lvds_7to1_ddr_8lane_eval_V1_0/ | |
| pgr_lvds_7to1_ddr_8lane_eval_V1_0/bench/ | |
| pgr_lvds_7to1_ddr_8lane_eval_V1_0/bench/lvds_7to1_ddr_top_tb.v | 1KB |
| pgr_lvds_7to1_ddr_8lane_eval_V1_0/docs/ | |
| pgr_lvds_7to1_ddr_8lane_eval_V1_0/docs/AN04008 PG2L100H LVDS7TO1应用指南.pdf | 1167KB |
| pgr_lvds_7to1_ddr_8lane_eval_V1_0/pnr/ | |
| pgr_lvds_7to1_ddr_8lane_eval_V1_0/pnr/generate_bitstream/ | |
| pgr_lvds_7to1_ddr_8lane_eval_V1_0/pnr/generate_bitstream/lvds_7to1_ddr_top.sbit | |
| pgr_lvds_7to1_ddr_8lane_eval_V1_0/pnr/pgr_lvds_7to1.pds | |
| pgr_lvds_7to1_ddr_8lane_eval_V1_0/sim/ | |
| pgr_lvds_7to1_ddr_8lane_eval_V1_0/sim/lvds_sim.bat | |
| ... | |
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