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PDP显示驱动芯片中高低压转换电路的设计

更新时间：2019-06-23 23:07:03 大小：15M 上传用户：sun2152查看TA发布的资源 标签：pdp高低压转换电路 下载积分：1分 评价赚积分 （如何评价?） 打赏 收藏 评论(0) 举报

资料介绍

本论文综述了PDP的特点、应用以及国内外PDP行列高压驱动芯片的研究和发展现状。对PDP驱动芯片中高低压转换电路的研究和发展现状做了简略的介绍，分析了这类电路的特点和改进方向。以此为基础提出了一系列用于指导该类电路开发的设计原则和一套科学可行的设计方案。随后在这些原则的指导下，应用该方案基于无锡上华1.5um标准CMOS工艺线设计了PDP数据选址芯片SED9006S7中的高低压转换电路。该设计方案分低压延时驱动电路设计和信号电平提升电路设计两部分，低压延时驱动部分又分为延时级电路设计和驱动级电路设计。在研究了多种延时级电路的基础上提出了一种易丁调整延迟时间的新结构的延时级电路。在信号电平提升电路的设计优化方案中，针对最常用的CMOS六管结构的高压电路通过Hspice软件仿真确定了各设计参数对最终设计目标的影响。该设计方案分为三个步骤，逐步缩小了优化范围，最终通过高低压电路的整体联调确定了应用在PDP的数据选址芯片SED9006S7中的高低压转换电路的各器件尺寸参数。在对版图进行了工艺兼容性设计和工艺可靠性设计之后在无锡上华流片。对流片后的测试结果进行了分析和比较，验证了该设计的正确性和可行性。在论文最后的展望中提出了该课题的后续研究方向。

SED9006S7芯片的实测结果显示该芯片的电压、电流、功耗和频率等技术指标均符合实用要求，且优于国外同类芯片，而加工成本也大大低于国外同类产品。该设计方案的提出，向研制具有自主知识产权的低成本的PDP驱动芯片的日标又迈出了坚实的一步。

本论文在低压电路结构上有所创新，提出了一种易下调节低压驱动信号延时大小的低压延时电路。同时对常用的实用型的信号电平提升电路的设计方法进行了摸索和总结，归纳出一套完整可行的设计验证方案。目前国内对PDP驱动芯片中的高低压转换的电路的研究还比较薄弱，在这个方面的文献和资料都比较少，本论文的研究具有一定的开拓性，希望可以抛砖引玉，为后续的研究工作提供一个有价值的参考和启发。


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