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JK触发器鉴相器
资料介绍
一、鉴相器概述
鉴相器（Phase Detector）是一种能够比较两个输入信号相位差并输出对应直流电压的电路，广泛应用于锁相环（PLL）、频率合成器等电子系统中。JK触发器作为一种具有置位、复位、保持和翻转功能的时序逻辑器件，可通过合理设计构成鉴相器，实现对输入信号相位关系的检测。
（二）典型电路结构
常见的JK触发器由两个与或非门交叉耦合构成，具有主从型和边沿型两种结构。边沿型JK触发器（如74LS112）仅在时钟脉冲的下降沿（或上升沿）时刻响应输入信号，抗干扰能力强，是构成鉴相器的理想选择。
三、JK触发器鉴相器工作原理
（一）电路组成
JK触发器鉴相器通常由JK触发器、输入信号处理电路及低通滤波器（LPF）组成。其中：
· 输入信号：通常为参考信号（fref）和压控振荡器输出信号（fvco）
· JK触发器：核心鉴相单元，通过J、K端接收相位信号，输出与相位差相关的脉冲信号
· 低通滤波器：将触发器输出的脉冲信号转换为直流控制电压
（二）相位比较机制
以下降沿触发的JK触发器为例，其鉴相原理如下：
1. 将参考信号（fref）接入CP端，VCO输出信号（fvco）经反相后接入J端，同时VCO信号直接接入K端；
2. 当fref与fvco频率相等时，根据两者相位差不同，触发器输出Q端将产生不同占空比的脉冲：
o 若fref相位超前fvco，Q端输出高电平脉冲宽度与相位差成正比；
o 若fref相位滞后fvco，
端输出高电平脉冲宽度与相位差成正比；
o 若两者同相位，Q端输出稳定低电平（或高电平）。
3. Q端和端输出的脉冲经低通滤波器平滑后，得到与相位差相关的直流电压Ud，该电压可用于控制VCO的频率。
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