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HDB3码编码器及解码器verilog代码编程及实现

更新时间：2021-02-02 16:24:12 大小：1M 上传用户：hgjhgjhgj查看TA发布的资源 标签：HDB3码编码器解码器verilog 下载积分：2分 评价赚积分 （如何评价?） 打赏 收藏 评论(0) 举报

资料介绍

1、连0的个数不超过3时，规则与AMI相同，即0不变，1变为-1、+1交替；

2、若连0的个数超过3，则将每4个0看作一小节，定义为B00V，B可以是-1、0、+1，V可以是-1、+1；

3、B和V具体值满足以下条件：V和前面相邻非0符号极性相同；不看V时极性交替；V与V之间极性交替；

4、一般第一个B取0，第一个非0符取-1。

在V与V之间如果出现偶数个B时，应在后一个V字节补一个B'，定义为B'00V，B'与前面相邻的B之间符号极性相反，这个字节的V和B'符号极性相同


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