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基于FPGA动态可重构计算机的三模冗余改进法

更新时间：2020-11-01 07:40:37 大小：2M 上传用户：zhengdai查看TA发布的资源 标签：fpga 下载积分：2分 评价赚积分 （如何评价?） 打赏 收藏 评论(0) 举报

资料介绍

为了提高动态可重构计算机自身的抗干扰能力,提出一种基于FPGA的动态可重构计算机的三模冗余改进法.采用三模块比较的容错模式,通过对三模冗余的多数表决电路进行检测和动态重构提升整个系统的容错能力,从而降低系统因表决电路故障而产生的错误.经Virtex-4 FPGA的片上PowerPC处理器对该方法进行系统验证,证明此方法的有效性和正确性.

Aiming at the improvement of the anti-jamming capability of dynamic reconfigurable computers, an improved triple module redundancy(TMR) method based on FPGA was proposed. Through detecting and dynamic reconfiguration of the majority voter circuit of TMR, this methodology enhances the fault-tolerant performance of majority voter circuit, therefore, the probability of misoperation because of the failure of majority voter of TMR was reduced. The methodology had been verified through the on-chip PowerPC processor system of Virtex-4 FPGA. Experimental result supports the effectiveness of this approach presented.

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