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FPGA中低噪声CCD时序驱动电路设计

更新时间：2020-08-27 06:18:49 大小：782K 上传用户：IC老兵查看TA发布的资源 标签：fpgaccd时序驱动电路 下载积分：5分 评价赚积分 （如何评价?） 打赏 收藏 评论(0) 举报

资料介绍

在分析Toshiba公司TCD1209D型CCD工作原理的基础上,分析了驱动时序的关系,详细介绍了驱动电路的设计和实现方法.用Verilog语言设计了TCD 1209D的驱动时序控制电路;选用CyclonelⅣ系列FPGA器件,使用QuartusⅡ软件对设计电路进行了功能仿真,实现了TCD1209D的高速时序驱动;在CycloneⅣ芯片平台上测试了TCD 1209D的实际输出信号.实验结果显示,CCD信号噪声较小,验证了所设计驱动电路的可行性,确定了相关双采样的时刻和位置,为小型CCD测量系统的设计提供了有益参考.

Based on TCD1209D CCD produced by Toshiba, this paper construed the drive signals timing relationgship, and ex- plained the drive circuit design methord. It designed the TCD1209D drive timing logic circuit by using the Verilog language, and choieed the CyclonelV series FPGA device and employed the QuartuslI software platform to simulate and verify the CCD drive mod- ule＇s function, so that it have realised high speed drive for TCD1209D. It tested the output signal of TCD1209D on the CyclonelV hardware platform at last. Results show that the CCD output signal noise is low, and it makes sure the CDS sample position and time point. It＇s a reference for the design of the CCD measureme...

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