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基于FPGA的一个FIR低通滤波器设计，要求使用Verilog语言编写滤波器模块

更新时间：2019-10-30 10:57:36 大小：1M 上传用户：lalahug查看TA发布的资源 标签：fpgafir低通滤波器verilog 下载积分：9分 评价赚积分 （如何评价?） 打赏 收藏 评论(0) 举报

资料介绍

基于FPGA的一个FIR低通滤波器设计，要求使用Verilog语言编写滤波器模块，通过编译和综合，并通过Matlab和modelsim联合仿真验证设计结果

部分文件列表

文件名文件大小修改时间
fir_verilog_matlab/fir/db/add_sub_l9h.tdf1KB2012-12-06 09:43:52
fir_verilog_matlab/fir/db/add_sub_m9h.tdf1KB2012-12-06 09:43:52
fir_verilog_matlab/fir/db/altsyncram_is81.tdf14KB2012-12-06 09:43:50
fir_verilog_matlab/fir/db/fir.(0).cnf.cdb2KB2012-12-06 09:43:48
fir_verilog_matlab/fir/db/fir.(0).cnf.hdb1KB2012-12-06 09:43:48
fir_verilog_matlab/fir/db/fir.(1).cnf.cdb2KB2012-12-06 09:43:48
fir_verilog_matlab/fir/db/fir.(1).cnf.hdb1KB2012-12-06 09:43:48
fir_verilog_matlab/fir/db/fir.(10).cnf.cdb1KB2012-12-06 09:43:52
fir_verilog_matlab/fir/db/fir.(10).cnf.hdb1KB2012-12-06 09:43:52
fir_verilog_matlab/fir/db/fir.(11).cnf.cdb2KB2012-12-06 09:43:52
fir_verilog_matlab/fir/db/fir.(11).cnf.hdb1KB2012-12-06 09:43:52
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