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FPGA中PLL模块的测试代码，代码通过例化一个PLL将25MHz系统时钟倍频到50MHz

更新时间：2019-10-15 22:06:29 大小：142K 上传用户：zyf901126查看TA发布的资源 标签：fpgapll模块 下载积分：9分 评价赚积分 （如何评价?） 打赏 收藏 评论(0) 举报

资料介绍

FPGA中PLL模块的测试代码，代码通过例化一个PLL将25MHz系统时钟倍频到50MHz，然后通过两个不同频率时钟控制两个LED灯闪烁，通过闪烁频率可用观察PLL倍频效果.rar

部分文件列表

文件名文件大小修改时间
Pll_prj/.sopc_builder/filters.xml1KB2012-04-27 12:47:56
Pll_prj/db/logic_util_heursitic.dat1KB2012-04-27 12:27:06
Pll_prj/db/pll.(0).cnf.cdb1KB2012-04-27 12:01:42
Pll_prj/db/pll.(0).cnf.hdb1KB2012-04-27 12:01:42
Pll_prj/db/pll.(1).cnf.cdb2KB2012-04-27 12:01:42
Pll_prj/db/pll.(1).cnf.hdb1KB2012-04-27 12:01:42
Pll_prj/db/pll.(2).cnf.cdb2KB2012-04-27 12:01:42
Pll_prj/db/pll.(2).cnf.hdb1KB2012-04-27 12:01:42
Pll_prj/db/pll.cbx.xml1KB2012-04-27 12:27:06
Pll_prj/db/pll.cmp.rdb8KB2012-04-27 12:27:06
Pll_prj/db/pll.cmp_merge.kpt1KB2012-04-27 12:27:06
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