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基于FPGA的AES加密算法实现的Verilog代码,包含一个顶层文件和两个调用模块,.rar
资料介绍
基于FPGA的AES加密算法实现的Verilog代码,包含一个顶层文件和两个调用模块,最高误差在15ns.rar
部分文件列表
文件名 | 文件大小 | 修改时间 |
AES based on FPGA-jiami/aes_cipher_top.v | 7KB | 2013-04-21 18:35:34 |
AES based on FPGA-jiami/aes_cipher_top.v.bak | 7KB | 2013-04-18 13:57:42 |
AES based on FPGA-jiami/aes_cipher_top.vwf | 161KB | 2013-04-18 13:57:46 |
AES based on FPGA-jiami/aes_key_expand_128.v | 1KB | 2013-04-17 13:49:14 |
AES based on FPGA-jiami/aes_key_expand_128.v.bak | 3KB | 2013-04-17 13:19:46 |
AES based on FPGA-jiami/aes_key_expand_128.vwf | 125KB | 2013-04-18 17:33:24 |
AES based on FPGA-jiami/aes_sbox.v | 6KB | 2013-04-17 13:50:00 |
AES based on FPGA-jiami/aes_sbox.v.bak | 7KB | 2013-04-16 19:41:58 |
AES based on FPGA-jiami/db/logic_util_heursitic.dat | 267KB | 2013-04-21 18:39:16 |
AES based on FPGA-jiami/db/mux_src.tdf | 4KB | 2013-04-16 19:49:12 |
AES based on FPGA-jiami/db/prev_cmp_www.asm.qmsg | 2KB | 2013-04-21 18:35:48 |
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