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FPGA/CPLD数字电路设计经验
资料介绍
FPGA/CPLD数字电路设计经验分享，包含数字设计中的几个基本概念：建立时间和保持时间，竞争和冒险现象，清除和置位信号，触发器和锁存器；以及FPGA/CLD中的一些设计方法，包括：FPGA设计中的同步设计，FPGA设计中的延时电路的产生，如何提高系统的运行速度，信号输出，寄存器异步输入信号，FPGA/CPLD中的时钟设计等。是一篇很好的经验分享，相信对大家的FPGA/CPLD设计会有很大帮助，特此来分享给各位硬件爱好者！
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| 文件名 | 大小 |
| fpga经验谈.pdf | 1M |
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