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FPGA的MIPS-CPU的设计
资料介绍
重点分析了由于流水线设计而引入的竞争与冒险，分析了在不同流水线阶段可能存在的竞争与冒险，对引起竞争与冒险的原因进行了确定，并通过增加一些电路逻辑来避免竞争与胃险的发生，完成了竞争与冒险检测电路模块以及数据回写前馈电路模块的代码编写，从而解决了竞争与冒险的问题，使设计的5级流水线得以畅顺实现。
完成了MIPS-CPU的仿真系统平台的搭建，该仿真器用来对应用程序进行编译，链接与执行，生成相应汇编语言程序以及向量文件（16进制机器码）；并且同时产生相关的Modelsim仿真，及QuartusIⅡ下载验证的文件。本设计利用该仿真系统来评估设计的MIPS-CPU的硬件系统，模拟仿真结果证明本文设计的MIPS-CPU可以实现正常功能。本论文课题的研究成功对今后从事专用RISC-CPU设计的同行提供了有益的参考。
最终将设计的MIPS-CPU下载到ALTERA公司的FPGA-EPIC60240芯片，并且借助ALTERA公司提供的Quartus IⅡ软件进行了编译与验证，对设计的MIPS-CPU的资源使用，关键路径上的时序，布线情况进行了分析，最终完成各个指标的检查，并且借助Quartus Il软件内嵌的SignalTap软件进行软硬件联合调试，结果表明设计的MIPS-CPU功能正常，满足约束，指标正确。
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| 基于FPGA的MIPS-CPU的设计.pdf | 22M |
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资料：bitboy
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