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FPGA的正弦信号发生器研究与设计
资料介绍
本课题的研究就是针对某学校数字电子技术实验室数字信号源的需求为背景展开的。本设计采用ALTERA公司的Cyclone系列FPGA为数字平台，利用VHDL语言在FPGA中设计出了产生正弦信号的DDS器件，并将其封装成IP核；然后运用了基于Nios II嵌入式处理器的SOPC技术对DDSIP核加以控制。整个系统可以实现1Hz~40MHz的正弦信号输出、其最小步进频率达到1Hz；并能实现调幅、调频、二进制PSK、二进制ASK调制等功能。
论文详细的介绍了该系统的软件实现和各部分的硬件实现，着重对DDS的设计过程、工作原理及其输出信号的性能进行了分析；对DDSIP核的形成、NIOS软处理器的设计与实现等问题进行了比较系统的研究。
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