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FPGA的误码率测试仪设计.
资料介绍
本设计主要分为误码仪硬件电路的设计和FPGA内部功能的VHDL软件设计两个部分，硬件设计主要是CPU和FPGA的外围电路设计以及它们之间的互联。软件设计主要是使用硬件编程语言VHDL 编程，实现了传输速率在10/100/1000Mbps三种速率可调、9位，11位，15位，23位，31位五种序列长度伪随机码码型可选等误码仪主要功能。
在误码仪的设计中采用以FPGA芯片为主的硬件设计，该单片FPGA芯片集测试码发送，接收，统计，计算等功能于一体，加以外部少量辅助电路即可完成整个误码仪的设计，因此误码仪的体积，重量，成本得到了很大的精简。
文章最终完成了误码仪的系统的开发制作，包括误码仪硬件开发板的制作以及基于FPGA的误码仪内核逻辑的开发，可以完成基本的误码仪功能，整个硬件开发成本低廉，证明了基于FPGA的误码仪系统设计是可行且有效的。
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| 文件名 | 大小 |
| 基于FPGA的误码率测试仪设计.pdf | 18M |
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