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FPGA的FFT处理器的设计
资料介绍
（1)该方法采用了按时间抽取（DIT）基-4算法和5级流水线结构，并对核心单元蝶
形处理器和流水线结构进行改进设计，使其在节约了大约75?硬件面积的同时还
大大提高了运算的速度，从而达到系统高速实时的要求。
（2）设计内置双端口RAM存储数据，控制简单，而且速度很快；用ROM存储旋转因
子，并采用查找表的方式取数，节省时间。
（3）为了避免数据溢出，采用块浮点结构来表示数据，这是对定点和浮点数一种很
好的折中，节省了大量器件资源。
（4）最后通过Matlab仿真结果对硬件实现FFT算法进行验证，以证明本文所提出
的方法的正确性。试验结果表明，该方法在保证运算精度和实现复杂度的同时，
提高了处理器的数据时钟频率和处理速度，达到了预期的目标。
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| 文件名 | 大小 |
| 基于FPGA的FFT处理器的设计.pdf | 8M |
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