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基于FPGA的8位加法器技术
资料介绍
基于FPGA的8位加法器技术
加法器是数字系统中的基本逻辑器件，可以直接实现加法操作，同时，也可通过组合构成实现减法器和硬件乘法器。加法器可随着是否有低位输入简单分为半加器和全加器。而多位加法器的构成有两种方式：并行进位和串行进位。并行进位加法器设有进位产生逻辑，运算速度较快；串行进位方式是将全加器级联构成多位加法器并行进位加法器通常比串行级联加法器占用更多的资源。随着位数的增加，相同位数的并行加法器与串行加法器的资源占用差距也越来越大。因此，在工程中使用加法器时，要在速度和容量之间寻找平衡点。
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| 文件名 | 大小 |
| 基于FPGA的8位加法器技术.doc | 593K |
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