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基于(EP2C8Q) FPGA 设计单一数码管驱动Verilog源码Quartus9.0工程文件
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文件名 | 文件大小 | 修改时间 |
基于(EP2C8Q) FPGA 设计单一数码管驱动Verilog源码Quartus9.0工程文件/Modelsim/DIGITAL_TURE.mpf | 30KB | 2011-04-30 23:35:58 |
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基于(EP2C8Q) FPGA 设计单一数码管驱动Verilog源码Quartus9.0工程文件/Modelsim/work/@d@i@g@i@t@a@l_@t@u@b@e_@c@t@l/verilog.asm | 23KB | 2011-08-05 16:12:40 |
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资料:bitboy
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