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emmc性能优化
资料介绍
eMMC spec performance
* Typically emphasizes sequential write performance
* Random accesses hit eMMCs internal pipelines
* Frequently limited by eMMC's Random IOPs limit
* Minimum OP time regardless of OP size
* Not often data BW limited
*-200 1OPs (e.g. 4kB per OP)
* Analyze application's eMMC read/writes patterns
Cache is King
Alleviates write performance issues
* Improves read times even further
* Reduces NAND wear
MMC driver
* Maximum bandwidth enabled (8-bit, 50MHz)
* Enable DMA if option Power management
* Trim/vendor command support
* Benchmarking Log
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