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QUAtus II EDA实验
资料介绍
EDA实验，开发环境QUATUS，VErilog
部分文件列表
| 文件名 | 大小 |
| EDA实验/ | |
| 状态机逻辑电路设计.ppt | |
| EDA实验/实验二 硬件描述语言（Verilog HDL)软件基本使用方法.ppt | |
| EDA实验/实验六 时序逻辑电路设计Ⅰ.ppt | |
| EDA实验/实验七 时序逻辑电路设计Ⅱ.ppt | |
| EDA实验/实验三 几种逻辑功能描述电路设计.ppt | |
| EDA实验/实验四 层次化逻辑电路设计.ppt | |
| EDA实验/实验五 组合逻辑电路设计.ppt | |
| EDA实验/实验一 Quartus Ⅱ软件功能和使用方法.ppt |
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