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VHDL的原理
资料介绍
VHDL是超高速集成电路（VHSIC）硬件描述语言的首字母缩写，它是一种编程语言，按功能，数据流行为和/或结构描述逻辑电路。 该硬件描述用于配置可编程逻辑器件（PLD），例如现场可编程门阵列（FPGA），具有定制逻辑设计。
VHDL程序的一般格式是围绕BLOCKS的概念构建的，BLOCKS是VHDL设计的基本构建单元。 在这些设计模块中，可以容易地描述功能的逻辑电路。
VHDL设计以ENTITY块开始，该块描述了设计的接口。 该接口定义了所设计电路的输入和输出l1ogic信号。 ARCHITECTURE块描述了设计的内部操作。 在这些块内有许多其他功能块，用于构建正在创建的逻辑电路的设计元素。
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