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基于双CPU的数字存储示波器的设计和实现
资料介绍
本文给出了一台最高采样速率为100MS/s,带宽达到20MHz的实时采样数字存储示波器的系统设计和实现方案.仪器采用了单片机+DSP的双CPU系统结构.使用高速A/D转换器和先入先出存储器FIFO构成数据采集和存储模块,完成系统在各种速度下的数据采集和存储任务;以高速数字信号处理芯片DSP为核心的数据处理模块,完成采样数据的各种后续处理;采用Altera公司的大规模可编程逻辑器件CPLD,实现对数据采集模块的控制功能,提高了系统的集成度;使用液晶显示器,实现了全中文菜单界面,配合键盘控制,组成了良好的人机对话界面;单片机作为主CPU,实现对整机内各模块的协调控制.本文首先介绍了系统的总体结构,接着分章节详细阐述了各个主要功能模块的工作原理、软件设计思想等,最后给出了系统的设计结果和改进建议.
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