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ARM嵌入式应用平台的x86指令译码器
资料介绍
随着新的体系结构和操作系统的发展，对计算机系统间的互操作性要求越来越高。二进制翻译技术可以将一种ISA的二进制机器码翻译到另一种ISA的二进制机器码，进而达到实现原有应用程序到一种新的硬件平台的移植的要求。本文研究了x86和ARM两种处理器的架构、指令寻址方式以及指令编码并且提出了一种32位x86指令到ARM指令的静态二进制翻译的硬件实现方法，用Verilog硬件描述语言实现了进行静态二进制翻译的核心模块Decoder模块，能够处理130多条×86指令，同时对适用Decoder模块的x86汇编程序和ARM架构提出了限制条件。通过设计了一个TLB模块，提高整个译码系统的吞吐量。最后将该译码模块成功的集成到基于ARM核的SoC上进行系统验证。译码模块还有很多不足，需要今后进一步地研究。从而提高译码效率。
关键词:x86指令,ARM指令,Decoder ,TLB ,ARM7
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| 基于ARM嵌入式应用平台的x86指令译码器设计.pdf | 9M |
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