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基于Altera系列芯片lvds接口的FPGA设计，Verilog源码.

更新时间：2019-10-19 17:58:15 大小：434K 上传用户：lalahug查看TA发布的资源 标签：alteralvds接口fpga 下载积分：9分 评价赚积分 （如何评价?） 打赏 收藏 评论(0) 举报

资料介绍

基于Altera系列芯片lvds接口的FPGA设计，Verilog源码.

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部分文件列表

文件名文件大小修改时间
LVDS的应用的Verilog HDL例子程序(由Altera公司提供)/sim/comp_altera_lib.do1KB2003-01-21 17:43:20
LVDS的应用的Verilog HDL例子程序(由Altera公司提供)/sim/comp_gate.do1KB2003-01-23 16:43:36
LVDS的应用的Verilog HDL例子程序(由Altera公司提供)/sim/diff_io_top.vo74KB2003-01-23 15:19:16
LVDS的应用的Verilog HDL例子程序(由Altera公司提供)/sim/diff_io_top_v.sdo51KB2003-01-23 15:19:16
LVDS的应用的Verilog HDL例子程序(由Altera公司提供)/sim/gate_sim.do1KB2003-01-23 16:40:58
LVDS的应用的Verilog HDL例子程序(由Altera公司提供)/sim/stratix/@p@r@i@m_@d@f@f@e/verilog.asm1KB2003-01-23 16:26:40
LVDS的应用的Verilog HDL例子程序(由Altera公司提供)/sim/stratix/@p@r@i@m_@d@f@f@e/_primary.dat1KB2003-01-23 16:26:40
LVDS的应用的Verilog HDL例子程序(由Altera公司提供)/sim/stratix/@p@r@i@m_@d@f@f@e/_primary.vhd1KB2003-01-23 16:26:40
LVDS的应用的Verilog HDL例子程序(由Altera公司提供)/sim/stratix/and1/verilog.asm2KB2003-01-23 16:26:40
LVDS的应用的Verilog HDL例子程序(由Altera公司提供)/sim/stratix/and1/_primary.dat1KB2003-01-23 16:26:40
LVDS的应用的Verilog HDL例子程序(由Altera公司提供)/sim/stratix/and1/_primary.vhd1KB2003-01-23 16:26:40
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