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一个可综合的8051兼容处理器核设计
资料介绍
8051系列单片机是应用最广泛生命周期最长久的8位单片机。具有强大的生命力和市场前景。 本文主要介绍了一款51系列单片机的软IPCORE：使用VerilogHDL语言设计的80C51单片机的IPCORE。 本论文的主体部分由四部分构成，第一部分，介绍了经典的INTEL的MCS8051的框架结构和内部功能模块的组成，从而明确了本次设计的任务目标；第二部分，分析了8051的指令集的特点，在本设计中把指令的执行流程基本划分为取指，译码，取指令参数，运算，回写五个步骤，每个步骤在各类指令中的时序安排，并举例列出几种指令按照这个步骤执行的情况；第三部分，按照INTEL的MCS8051手册的描述，详细介绍了本论文中各模块实现的结构图和工作原理，包括了特殊寄存器，运算逻辑单元，定时器，中断等。最后一部分是本次论文的测试验证和总结。 本设计采用CANDENCE的VerilogXL及modelsim5．7进行功能仿真以及时序仿真，采用Altera公司的开发工具QUARTUSII5．0作为开发平台，完成设计的综合、静态时序分析工作；采用Altera公司的CYCLONE系列的EPlC6T144C6芯片进行物理设计。 在设计手段上，设计主要遵循INTELMCS51系列的单片机用户手册以及官方的正式资料，采用了自顶向下将系统按功能逐层分割的层次化、模块化的设计方法，这比传统自下向上的EDA设计方法有更明显的优势，缩短了开发周期，降低了开发成本。先进工艺以及设计手段的采用也是保证性能提高的一大因素；
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