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4通道12bit位宽的DA芯片AD5724 Verilog驱动源码+芯片技术手册
资料介绍
4通道12bit位宽的DA芯片AD5724 Verilog驱动源码+芯片技术手册
module ad5724_ctrl #(
parameter DATA_WIDTH = 12,
parameter RANG_WIDTH = 16
)(
input wire clk , //这里的时钟频率为50M，如果降低时钟频率请同步降低触发周期i_trig
// 提高频率需要代码中o_da5724_sclk的周期
input wire rst_n ,
input wire i_trig , //DA输出数据更新触发信号，在50M时钟频率下可以设置为5us
input wire [DATA_WIDTH - 1 : 0] i_ch1_data ,
input wire [DATA_WIDTH - 1 : 0] i_ch2_data ,
input wire [DATA_WIDTH - 1 : 0] i_ch3_data ,
input wire [DATA_WIDTH - 1 : 0] i_ch4_data ,
input wire [RANG_WIDTH - 1 : 0] i_out_range , //设置为16'd4 表示输出正负10V
input wire i_ad_en ,
input wire i_da5724_sdout ,
output wire o_da5724_sclk ,
output wire o_da5724_sdin ,
output wire o_da5724_sync_n ,
output wire o_da5724_ldac_n ,
output wire o_da5724_clr_n
);
部分文件列表
| 文件名 | 大小 |
| AD5754_evalSoftware/ | |
| AD5754_evalSoftware/AD5754setup_rev1.8.exe | 4676KB |
| ad5724_ctrl.v | |
| AD5724.pdf | 1127KB |
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