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基于FPGA的DHT11 verilog源代码
资料介绍
部分文件列表
文件名 | 文件大小 | 修改时间 |
wendu/db/add_sub_unc.tdf | 2KB | 2012-11-26 16:18:42 |
wendu/db/add_sub_vnc.tdf | 2KB | 2012-11-26 16:18:42 |
wendu/db/alt_u_div_13f.tdf | 10KB | 2012-11-26 16:18:42 |
wendu/db/lpm_divide_agm.tdf | 2KB | 2012-11-27 15:58:56 |
wendu/db/lpm_divide_d8m.tdf | 2KB | 2012-11-26 16:18:42 |
wendu/db/prev_cmp_webdu.asm.qmsg | 2KB | 2012-11-27 17:58:18 |
wendu/db/prev_cmp_webdu.fit.qmsg | 29KB | 2012-11-27 17:58:18 |
wendu/db/prev_cmp_webdu.map.qmsg | 21KB | 2012-11-27 17:58:18 |
wendu/db/prev_cmp_webdu.qmsg | 73KB | 2012-11-27 17:48:24 |
wendu/db/prev_cmp_webdu.sta.qmsg | 21KB | 2012-11-27 17:58:18 |
wendu/db/sign_div_unsign_bkh.tdf | 2KB | 2012-11-26 16:18:42 |
... |
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全部评论(5)
2019-01-07 13:45:50ayou123
就没有具体的图么? 基于EP2C8Q208C8该怎么确定引脚连接呢?
2018-04-10 13:16:45一个小小白
经典实用
2017-04-23 10:57:55休杰克曼
检测出的值过一段时间就不改变了
2017-03-09 09:37:07alalayoo
很不错的资料
2016-11-19 23:52:42liping09003
可以用~