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基于verilog的大量实例代码
资料介绍
基于verilog的实例代码
部分文件列表
| 文件名 | 文件大小 | 修改时间 |
| 基于verilog的实例代码/verilog实例/ADC_16bit.v | 4KB | 2005-09-02 19:08:48 |
| 基于verilog的实例代码/verilog实例/adder_8bit.v | 1KB | 2005-09-02 19:08:48 |
| 基于verilog的实例代码/verilog实例/adder_8bit_2.v | 1KB | 2005-09-02 19:08:48 |
| 基于verilog的实例代码/verilog实例/ALL.V | 1KB | 2005-09-02 19:08:48 |
| 基于verilog的实例代码/verilog实例/binarytogray.v | 1KB | 2005-09-02 19:08:48 |
| 基于verilog的实例代码/verilog实例/cla_8bits.v | 2KB | 2005-09-02 19:08:48 |
| 基于verilog的实例代码/verilog实例/COMPARE.V | 1KB | 2005-09-02 19:08:48 |
| 基于verilog的实例代码/verilog实例/dds.v.txt | 2KB | 2005-09-02 19:08:48 |
| 基于verilog的实例代码/verilog实例/DECODER1.V | 1KB | 2005-09-02 19:08:48 |
| 基于verilog的实例代码/verilog实例/decoder3x8.v | 1KB | 2005-09-02 19:08:48 |
| 基于verilog的实例代码/verilog实例/div16.v.txt | 7KB | 2005-09-02 19:08:48 |
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