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实用的Verilog串口例子
资料介绍
部分文件列表
文件名 | 文件大小 | 修改时间 |
UartLoop/SRC/main.v | 1KB | 2013-06-28 12:54:54 |
UartLoop/SRC/sp6-dp.ucf | 1KB | 2013-08-12 16:22:46 |
UartLoop/SRC/UartRxd.v | 1KB | 2013-07-18 12:22:12 |
UartLoop/SRC/UartTxd.v | 2KB | 2013-07-04 23:16:20 |
UartLoop/UartLoop/iseconfig/main.xreport | 20KB | 2013-08-12 16:21:50 |
UartLoop/UartLoop/iseconfig/UartLoop.projectmgr | 6KB | 2013-08-12 16:40:28 |
UartLoop/UartLoop/main.bgn | 7KB | 2013-08-12 16:23:36 |
UartLoop/UartLoop/main.bit | 333KB | 2013-08-12 16:23:34 |
UartLoop/UartLoop/main.bld | 1KB | 2013-08-12 16:23:02 |
UartLoop/UartLoop/main.cmd_log | 1KB | 2013-08-12 16:23:28 |
UartLoop/UartLoop/main.drc | 1KB | 2013-08-12 16:23:32 |
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资料:bitboy
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