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systemverilog完整小程序
资料介绍
部分文件列表
文件名 | 文件大小 | 修改时间 |
module_example/cpu_core.sv.bak | 1KB | 2013-05-30 18:20:34 |
module_example/cpu_core1.sv | 1KB | 2013-05-30 18:23:28 |
module_example/mem_core.sv.bak | 1KB | 2013-05-30 18:45:20 |
module_example/mem_core1.sv | 1KB | 2013-06-16 21:03:54 |
module_example/module_example.cr.mti | 1KB | 2013-06-16 21:06:56 |
module_example/module_example.mpf | 79KB | 2013-06-16 21:04:14 |
module_example/top.sv.bak | 1KB | 2013-05-30 19:19:56 |
module_example/top1.sv | 1KB | 2013-05-30 19:44:12 |
module_example/vsim.wlf | 72KB | 2013-05-30 16:47:30 |
module_example/work/cpu_core/verilog.asm | 10KB | 2013-05-30 16:42:48 |
module_example/work/cpu_core/verilog.rw | 1KB | 2013-05-30 16:42:48 |
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