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基于FPGA设计I2C总线，使用Verilog语言
资料介绍
基于FPGA设计I2C总线，使用Verilog语言
部分文件列表
| 文件名 | 文件大小 | 修改时间 |
| I2c设计/I2c设计实验报告/addr.dat | 1KB | 2011-10-25 16:41:06 |
| I2c设计/I2c设计实验报告/data.dat | 1KB | 2011-10-25 16:41:18 |
| I2c设计/I2c设计实验报告/eeprom.v | 4KB | 2011-10-25 21:03:26 |
| I2c设计/I2c设计实验报告/eeprom_wr.v | 16KB | 2011-10-25 21:02:28 |
| I2c设计/I2c设计实验报告/I2c设计实验报告.doc | 69KB | 2011-11-06 22:41:22 |
| I2c设计/I2c设计实验报告/signal.v | 2KB | 2011-10-26 10:06:18 |
| I2c设计/I2c设计实验报告/top.v | 1KB | 2011-10-26 10:33:12 |
| I2c设计/I2c设计实验报告/写时序.png | 64KB | 2011-10-26 16:02:28 |
| I2c设计/I2c设计实验报告/读.png | 61KB | 2011-10-26 14:51:36 |
| I2c设计/I2c设计实验报告 | 1KB | 2013-04-24 22:37:38 |
| I2c设计 | 1KB | 2013-04-26 10:45:38 |
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