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基于fpga的测相的vhdl语言源代码和顶层原理图输入
资料介绍
基于fpga的测相的vhdl语言源代码和顶层原理图输入
部分文件列表
| 文件名 | 文件大小 | 修改时间 |
| FPGA测相/Block1.bdf | 3KB | 2011-05-11 00:40:04 |
| FPGA测相/xiangwei.asm.rpt | 8KB | 2011-05-18 18:04:48 |
| FPGA测相/xiangwei.bsf | 3KB | 2011-05-11 00:33:18 |
| FPGA测相/xiangwei.cdf | 1KB | 2011-05-17 10:43:06 |
| FPGA测相/xiangwei.done | 1KB | 2011-05-18 18:04:52 |
| FPGA测相/xiangwei.dpf | 1KB | 2011-05-17 10:40:06 |
| FPGA测相/xiangwei.fit.rpt | 95KB | 2011-05-18 18:04:44 |
| FPGA测相/xiangwei.fit.summary | 1KB | 2011-05-18 18:04:44 |
| FPGA测相/xiangwei.flow.rpt | 8KB | 2011-05-18 18:04:50 |
| FPGA测相/xiangwei.map.rpt | 18KB | 2011-05-18 18:04:36 |
| FPGA测相/xiangwei.map.summary | 1KB | 2011-05-18 18:04:36 |
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