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基于FPGA的数字滤波器(verilog编写)
资料介绍
部分文件列表
| 文件名 | 大小 |
| digital filter/ | 1KB |
| digital filter/clk_out_control_module.v | 1KB |
| digital filter/clk_out_count_module.v | 1KB |
| digital filter/clk_out_detect_module.v | 1KB |
| digital filter/clk_out_detect_module.v.bak | 1KB |
| digital filter/control_module.v | 1KB |
| digital filter/control_module.v.bak | 1KB |
| digital filter/count_module.v | 1KB |
| digital filter/count_module.v.bak | 1KB |
| digital filter/db/ | 1KB |
| digital filter/db/D_Filter.(0).cnf.cdb | 1KB |
| ... |
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