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verilog乘法器

更新时间：2012-04-24 08:42:30 大小：155K 上传用户：lydia2011查看TA发布的资源 标签：verilog乘法器 下载积分：5分 评价赚积分 （如何评价?） 打赏 收藏 评论(0) 举报

资料介绍

本文档是基于verilog的使用CAM方法编写的乘法器 源代码

部分文件列表

文件名文件大小修改时间
transcript1KB2011-12-21 22:10:38
vsim.wlf32KB2011-12-21 22:18:10
_xmsgs/xst.xmsgs1KB2011-12-02 14:00:34
CAM_xdb/tmp/ise/version1KB2011-12-21 23:05:54
CAM_xdb/tmp/ise/__OBJSTORE__/HierarchicalDesign/HDProject/HDProject1KB2011-12-21 23:05:54
CAM_xdb/tmp/ise/__OBJSTORE__/HierarchicalDesign/HDProject/HDProject_StrTbl1KB2011-12-21 23:05:54
CAM_xdb/tmp/ise/__OBJSTORE__/HierarchicalDesign/__stored_object_table__1KB2011-12-21 23:05:54
CAM_xdb/tmp/ise/__OBJSTORE__/PnAutoRun/Scripts/RunOnce_tcl1KB2011-12-21 22:00:14
CAM_xdb/tmp/ise/__OBJSTORE__/PnAutoRun/Scripts/RunOnce_tcl_StrTbl4KB2011-12-21 22:00:14
CAM_xdb/tmp/ise/__OBJSTORE__/ProjectNavigator/dpm_project_main/dpm_project_main1KB2011-12-21 23:05:52
CAM_xdb/tmp/ise/__OBJSTORE__/ProjectNavigator/dpm_project_main/dpm_project_main_StrTbl1KB2011-12-21 23:05:52
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