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加法器verilog代码

更新时间：2012-04-23 11:11:05 大小：135K 上传用户：lydia2011查看TA发布的资源 标签：verilog加法器代码 下载积分：5分 评价赚积分 （如何评价?） 打赏 收藏 评论(0) 举报

资料介绍

代码是用verilog编写的加法器的源代码，有进位选择，连波进位，还有进位跳跃多种方法描述全加器

部分文件列表

文件名文件大小修改时间
adder/adder.ise137KB2011-12-21 23:06:14
adder/adder.restore52KB2011-12-21 23:06:12
adder/adder_xdb/tmp/ise/version1KB2011-12-21 23:06:14
adder/adder_xdb/tmp/ise/__OBJSTORE__/HierarchicalDesign/HDProject/HDProject1KB2011-12-21 23:06:14
adder/adder_xdb/tmp/ise/__OBJSTORE__/HierarchicalDesign/HDProject/HDProject_StrTbl1KB2011-12-21 23:06:14
adder/adder_xdb/tmp/ise/__OBJSTORE__/HierarchicalDesign/__stored_object_table__1KB2011-12-21 23:06:14
adder/adder_xdb/tmp/ise/__OBJSTORE__/PnAutoRun/Scripts/RunOnce_tcl1KB2011-12-21 21:42:58
adder/adder_xdb/tmp/ise/__OBJSTORE__/PnAutoRun/Scripts/RunOnce_tcl_StrTbl4KB2011-12-21 21:42:58
adder/adder_xdb/tmp/ise/__OBJSTORE__/ProjectNavigator/dpm_project_main/dpm_project_main1KB2011-12-21 23:06:12
adder/adder_xdb/tmp/ise/__OBJSTORE__/ProjectNavigator/dpm_project_main/dpm_project_main_StrTbl1KB2011-12-21 23:06:12
adder/adder_xdb/tmp/ise/__OBJSTORE__/ProjectNavigator/__stored_objects__46KB2011-12-21 23:06:12
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