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用verilog编程实现的基于FPGA的AD数据采集程序
资料介绍
部分文件列表
| 文件名 | 文件大小 | 修改时间 |
| adc_1/adc_1.asm.rpt | 7KB | 2007-12-06 16:58:18 |
| adc_1/adc_1.done | 1KB | 2007-12-06 16:58:20 |
| adc_1/adc_1.fit.eqn | 4KB | 2007-12-06 16:58:14 |
| adc_1/adc_1.fit.rpt | 30KB | 2007-12-06 16:58:14 |
| adc_1/adc_1.fit.summary | 1KB | 2007-12-06 16:58:14 |
| adc_1/adc_1.flow.rpt | 3KB | 2007-12-06 16:58:20 |
| adc_1/adc_1.map.eqn | 3KB | 2007-12-06 16:58:02 |
| adc_1/adc_1.map.rpt | 12KB | 2007-12-06 16:58:02 |
| adc_1/adc_1.map.summary | 1KB | 2007-12-06 16:58:02 |
| adc_1/adc_1.pin | 25KB | 2007-12-06 16:58:14 |
| adc_1/adc_1.pof | 207KB | 2007-12-06 16:58:18 |
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