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串行FIR核的Verilog语言代码设计文件:已通过时序仿真验证.rar
大小:6M 更新时间:2019-10-14 下载积分:9分
串行FIR核的Verilog语言代码设计文件:已通过时序仿真验证.rar
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FPGA UART串口发送与接收VHDL硬件语言实现:附有仿真测试程序.zip
大小:6M 更新时间:2019-10-14 下载积分:9分
FPGA UART串口发送与接收VHDL硬件语言实现:附有仿真测试程序.zip